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SN65LVDS302ZXH

Name: Texas Instruments SN65LVDS302ZXH
Brand: Texas Instruments
SKU: 595-SN65LVDS302ZXH
Price: 3.04 EUR
Availability: InStock

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Mouser REF:

595-SN65LVDS302ZXH

Fabr. N.º:

SN65LVDS302ZXH

Fabr.:

Texas Instruments

Descripción:

CI de interfaz LVDS Programmable 27-bit display serial inter A 595-SN65LVDS302ZXHR

Hoja de datos:

SN65LVDS302ZXH Hoja de datos

Modelo ECAD:

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	2,28 €	22,80 €
	2,09 €	52,25 €
	1,88 €	188,00 €
	1,78 €	445,00 €
	1,70 €	979,20 €
	1,63 €	1.877,76 €
	1,60 €	4.608,00 €

Empaquetado alternativo

Fabr. N.º Ref.:

SN65LVDS302ZXHR

Embalaje:

Reel, Cut Tape, MouseReel

Disponibilidad:

En existencias

Precio:

2,56 €

Min:

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Fabr.:

Texas Instruments

Fabr. N.º:

SN65LVDS302ZXHR

Descripción:

Serializadores y deserializadores (Serdes) Programmable 27-bit display serial inter A 595-SN65LVDS302ZXH

Comparar con pieza actual

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Atributo del producto	Valor del atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	CI de interfaz LVDS
RoHS:
Tipo:	Serial Interface Receiver
Frecuencia de datos:	300 Mb/s
Tipo de entrada:	LVDS
Tipo de salida:	CMOS
Tensión del suministro - Máx:	1.95 V
Tensión del suministro - Mín:	1.65 V
Temperatura operativa mínima:	- 40 C
Temperatura operativa máxima:	+ 85 C
Estilo de montaje:	SMD/SMT
Empaquetado / Estuche:	NFBGA-80
Protección ESD:	With ESD Protection
Empaquetado:	Tray
Marca:	Texas Instruments
Sensibles a la humedad:	Yes
Pd (disipación de potencia):	64.7 mW
Producto:	LVDS Interface ICs
Tipo de producto:	LVDS Interface IC
Serie:	SN65LVDS302
Cantidad del paquete de fábrica:	576
Subcategoría:	Interface ICs

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TARIC:: 8542399000
USHTS:: 8542390090
ECCN:: EAR99

SN65LVDS302 Display Serial Interface Receiver

Texas Instruments SN65LVDS302 Programmable 27-Bit Display Serial Interface Receiver de-serializes FlatLink™ 3G compliant serial input data to 27 parallel data outputs. The Texas Instruments SN65LVDS302 receiver contains one shift register to load 30 bits from 1, 2, or 3 serial inputs. After checking the parity bit, it latches the 24-pixel and three control bits to the parallel CMOS outputs. If the parity check confirms correct parity, the Channel Parity Error (CPE) output remains low. If a parity error is detected, the CPE output generates a high pulse while the data output bus disregards the newly received pixel. Instead, the last data word is held on the output bus for another clock cycle.