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TMS320VC5501ZZZ300

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Mouser REF:

595-S320VC5501ZZZ300

Fabr. N.º:

TMS320VC5501ZZZ300

Fabr.:

Texas Instruments

Descripción:

Procesadores y controladores de señal digital (DSP, DSC) Fixed-Pt Dig Signal Proc

Ciclo de vida:

Obsoleto

Hoja de datos:

TMS320VC5501ZZZ300 Hoja de datos

Modelo ECAD:

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Atributo del producto	Valor del atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Procesadores y controladores de señal digital (DSP, DSC)
Restricciones de envío:	Actualmente Mouser no vende este producto en su región.
RoHS:
Producto:	DSPs
Núcleo:	C55x
Número de núcleos:	1 Core
Frecuencia máxima de reloj:	300 MHz
Empaquetado / Estuche:	BGA-201 Microstar
Tamaño de memoria del programa:	32 kB
Tamaño de datos RAM:	32 kB
Memoria de instrucción de caché L1:	16 kB
Voltaje operativo de suministro:	1.26 V
Serie:	TMS320VC5501
Nombre comercial:	TMS320
Estilo de montaje:	SMD/SMT
Temperatura operativa mínima:	- 40 C
Temperatura operativa máxima:	+ 85 C
Empaquetado:	Tray
Marca:	Texas Instruments
Anchura de bus de datos:	32 bit
Tamaño de datos ROM:	32 kB
Tipo de instrucción:	Fixed Point
Sensibles a la humedad:	Yes
Número de I/Os:	8 I/O
Tipo de producto:	DSP - Digital Signal Processors & Controllers
Tipo de memoria de programa:	Asynchronous SRAM, EPROM, Synchronous SDRAM, SBSRAM
Cantidad del paquete de fábrica:	126
Subcategoría:	Embedded Processors & Controllers
Peso unitario:	479,700 mg

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Application Notes

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Códigos de cumplimiento

TARIC:: 8542319000
CNHTS:: 8542319090
CAHTS:: 8542310000
USHTS:: 8542310035
JPHTS:: 8542310335
KRHTS:: 8542311000
MXHTS:: 8542310399
ECCN:: 3A991.a.2

Clasificaciones de origen

País de origen:: Filipinas
País de origen del ensamblaje:: No disponible
País de difusión:: No disponible

El país puede cambiar en el momento del envío.

TMS320VC5501 Fixed-Point Digital Signal Processor

Texas Instruments TMS320VC5501 Fixed-Point Digital Signal Processor (DSP) is based on the TMS320C55x DSP generation CPU processor core. The Texas Instruments TMS320C55x DSP architecture achieves high performance and low power through increased parallelism and total focus on reduction in power dissipation. The CPU supports an internal bus structure that is composed of one program bus, three data read buses, two data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to three data reads, and two data writes, in a single cycle. In parallel, the DMA controller can perform up to two data transfers per cycle independent of the CPU activity.