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CD74ACT164PWR

Name: Texas Instruments CD74ACT164PWR
Brand: Texas Instruments
SKU: 595-CD74ACT164PWR
Price: 0.76 EUR
Availability: InStock

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Mouser REF:

595-CD74ACT164PWR

Fabr. N.º:

CD74ACT164PWR

Fabr.:

Texas Instruments

Descripción:

Registros de desplazamientos de contadores 8-Bit Serial-In/Para llel-Out Shift Regi

Ciclo de vida:

Nuevo producto:

Novedad de este fabricante.

Hoja de datos:

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Modelo ECAD:

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	0,495 €	12,38 €
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	0,495 €	1.485,00 €

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Atributo del producto	Valor del atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Registros de desplazamientos de contadores
RoHS:
Tipo de contador:	Serial-In, Parallel-Out
Secuencia de recuento:	Serial to Parallel
Número de circuitos:	8 Circuit
Número de bits:	8 bit
Empaquetado / Estuche:	TSSOP-14
Familia lógica:	ACT
Tipo lógico:	Shift Register
Número de líneas de entrada:	4 Input
Tipo de salida:	Push-Pull
Tiempo de retraso de propagación:	6 ns
Tensión del suministro - Mín:	4.5 V
Tensión del suministro - Máx:	5.5 V
Temperatura operativa mínima:	- 55 C
Temperatura operativa máxima:	+ 125 C
Empaquetado:	Reel
Empaquetado:	Cut Tape
Marca:	Texas Instruments
Corriente de salida de alto nivel:	- 24 mA
Tipo de entrada:	CMOS
Corriente de salida de bajo nivel:	24 mA
Estilo de montaje:	SMD/SMT
Número de líneas de salida:	8 Output
Voltaje operativo de suministro:	4.5 V to 5.5 V
Producto:	Shift Registers
Tipo de producto:	Counter Shift Registers
Tipo de reinicio:	Asynchronous
Serie:	CD74ACT164
Cantidad del paquete de fábrica:	3000
Subcategoría:	Logic ICs
Tipo de disparo:	Rising Edge

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Atributos seleccionados: 0

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Códigos de cumplimiento

TARIC:: 8542319000
CNHTS:: 8542399000
USHTS:: 8542390090
MXHTS:: 8542399999
ECCN:: EAR99

Clasificaciones de origen

País de origen:: China
País de origen del ensamblaje:: No disponible
País de difusión:: No disponible

El país puede cambiar en el momento del envío.

CD74AC164/CD74ACT164 8-Bit SIPO Shift Registers

Texas Instruments CD74AC164/CD74ACT164 8-Bit SIPO Shift Registers have two serial inputs (A and B) connected through an AND gate and an asynchronous clear (CLR). The device requires a high signal on both A and B to set the input data line high; a low signal on either will set the input data line low. Data at A and B can be changed while CLK is high or low, provided the minimum set-up time requirements are met.